班級規模及環境--熱線:4008699035 手機:15921673576( 微信同號) |
每期人數限3到5人。 |
上課時間和地點 |
上課地點:【上?!浚和瑵髮W(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】:北京中山學院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領館區1號(中和大道) 【沈陽分部】:沈陽理工大學/六宅臻品 【鄭州分部】:鄭州大學/錦華大廈 【石家莊分部】:河北科技大學/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協同大廈
最近開課時間(周末班/連續班/晚班):2020年3月16日 |
實驗設備 |
☆資深工程師授課
☆注重質量
☆邊講邊練
☆合格學員免費推薦工作
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質量保障 |
1、培訓過程中,如有部分內容理解不透或消化不好,可免費在以后培訓班中重聽;
2、培訓結束后,授課老師留給學員聯系方式,保障培訓效果,免費提供課后技術支持。
3、培訓合格學員可享受免費推薦就業機會。 |
課程大綱 |
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- Cadence SI 仿真分析工具課程培訓
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Cadence SI 仿真分析工具課程培訓
課程概述
隨著通信電子行業的迅速發展,PCB設計的復雜程度越來越高,設計難度越來越大,低端的PCB設計工具如Protel等再不能勝任這種高密高速的PCB設計工作。Cadence的Allegro系列PCB設計工具作為業界領先的高端PCB設計平臺,以其設計流程完整,設計功能完善,簡單易用等諸特點為國內外越來越多知名企業采用。然而,信號完整性設計是一門跨學科的領域,對大多數硬件設計師來說,是一個全新的領域。本課程通過對Cadence信號完整性設計工具Specctraquest深入淺出講解,起到了對硬件設計師進入信號完整性設計領域拋磚引玉的作用,設計師對于信號完整性設計有初步的了解。?
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培訓內容
Allegro PCB SI 設計流程簡介
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1 Allegro PCB SI 設計流程
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2 Allegro PCB SI 工作界面
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3 元件布局
預布局
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1 數據準備
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2 模型編輯器 Model Integrity
創建DesignLink
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1 系統級仿真
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2 EBD和DML模型
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3 系統配置
線網拓撲結構抽取和仿真
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1布線前拓撲結構抽取
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2 Sigxplorer
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3 Sigwave
確定和添加規則
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1 Solution Space分析
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2 自定義測量
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3 參數掃描
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4 規則簡介
設計規則應用和規則驅動布局
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1 傳輸線模型
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2 Constraint Mananger
布線后分析
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1 電氣規則版本控制
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2 布線后分析
差分線仿真設計
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1差分線仿真模型
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2差分線定義
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3差分線仿真設計
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