 班級規模及環境--熱線:4008699035 手機:15921673576( 微信同號) |
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每期人數限3到5人。 |
| 上課時間和地點 |
上課地點：【上?！浚和瑵髮W(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】：北京中山學院/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領館區1號（中和大道） 【沈陽分部】：沈陽理工大學/六宅臻品 【鄭州分部】：鄭州大學/錦華大廈 【石家莊分部】：河北科技大學/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協同大廈
最近開課時間(周末班/連續班/晚班）：2020年3月16日 |
| 實驗設備 |
☆資深工程師授課
☆注重質量
☆邊講邊練
☆合格學員免費推薦工作
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| 質量保障 |
1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
2、培訓結束后,授課老師留給學員聯系方式,保障培訓效果,免費提供課后技術支持。
3、培訓合格學員可享受免費推薦就業機會。 |
課程大綱 |
課程介紹：
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高性能FPGA系統的設計實現需要研究包括設計方法學、算法和系統結構、代碼優化和綜合、設計和實現工具等關鍵問題。只有學習掌握好這幾個方面的知識，并深刻理解他們的關系，才能做到從總體上把握全系統，從而設計出滿足要求的高性能數字系統。所謂“會當凌絕頂，一覽眾山小”正是這樣一種感覺。
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FPGA系統設計實質上是一個同步時序系統的設計，理解時序概念，掌握代碼優化與綜合技術，正確完整地進行時序約束和分析是實現高性能系統的重要保證。本期課程按照“從宏觀到微觀，從頂層到底層”的系統設計原則，以“時序分析”和“系統集成”為主線，深入探討了“FPGA和FPGA數字系統”、“FPGA時序設計與時序分析”、“FPGA高級資源”、“面向時序性能的FPGA代碼設計與綜合技術”以及“FPGA高速I/O接口時序設計與分析”5大主題。
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課程講師均來自相關領域科研一線，具有扎實的理論功底和豐富的實踐經驗。課程內容結合了國外同類培訓課程內容和培訓講師的科研教學實踐，理論豐富，實驗合理，具有非常強的系統性和實用性，可以引導學員快速提高FPGA數字系統設計水平，更快創建設計，縮短開發時間，降低開發成本。
培訓對象：
課程適合于使用FPGA器件進行科研和產品開發的具有中等以上水平的工程技術人員，也適合于相關專業領域具有相當水平的教師和研究生。
1、工具平臺：Xilinx ISE 14.7
2、授課大綱
3.1 數字系統概述
3.2 FPGA和FPGA數字系統
3.3 FPGA時序設計與時序分析
3.4 面向時序性能的FPGA代碼設計與綜合技術
3.5 FPGA新資源
3.6 FPGA高速I/O接口設計 |
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