北京上海成都西安Design Compiler高級培訓班(Synopsys)哪家好哪里有收費情況深圳成都南京蘇州杭州

上課地點：【上�！浚和瑵髮W(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院【北京分部】：北京中山學院/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領館區1號（中和大道）【沈陽分部】：沈陽理工大學/六宅臻品【鄭州分部】：鄭州大學/錦華大廈【石家莊分部】：河北科技大學/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：協同大廈
最近開課時間(周末班/連續班/晚班）：Modelsim高級培訓班：2020年3月16日

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質量保障

        1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結束后,授課老師留給學員聯系方式,保障培訓效果,免費提供課后技術支持。
        3、培訓合格學員可享受免費推薦就業機會。

　　Modelsim高級培訓班(Mentor Graphics )

課程描述

Mentor Graphics 的ModelSim 是工業界最優秀的語言仿真器，它提供最友好的調試環境，是作FPGA、ASIC 設計的RTL 級和門級電路仿真的首選。它支持PC 和UNIX、LINUX 平臺，是唯一的單一內核支持VHDL 和Verilog 混合仿真的仿真器。

課程內容

1,功能驗證概要；

2,Tcl/Tk 功能介紹；

3,代碼覆蓋率；

4,仿真性能優化；

5,優化流程與方法；

6,統計性能分析；

7,虛擬對象與Signal Spy；

8,波形比較；

9,HDL 支持與門級仿真；

10,其他高級仿真技巧與總結

培養對象

從事FPGA/ASIC 設計與驗證工程師；希望更深入了解ModelSim 調試手段的工程師；希望從事FPGA/ASIC設計與驗證工程師的理工科背景在校生。

入學要求

        學員學習本課程應具備下列基礎知識：
        ◆ 理解FPGA/ASIC 設計流程；
        ◆ 對FPGA 設計和仿真有一定的經驗；
        ◆ 了解Verilog/VHDL 語言。